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CY14B512Q1, CY14B512Q2, CY14B512Q3: 512-Kbit (64 K × 8) Serial (SPI) nvSRAM | Cypress Semiconductor

CY14B512Q1, CY14B512Q2, CY14B512Q3: 512-Kbit (64 K × 8) Serial (SPI) nvSRAM

最終更新日: 
2015 年 8 月 31 日
バージョン: 
*J

特徴

  • 512-Kbit nonvolatile static random access memory (nvSRAM)
    • Internally organized as 64 K × 8
    • QuantumTrapの不揮発性要素へのSTORE処理は、電源オフ時に自動的に実行できるほか(AutoStore)、HSBピン(ハードウェアによる保存)またはSPI命令(ソフトウェアによる保存)を使用してユーザが明示的に実行することも可能
    • SRAMへのRECALL処理は、電源オン(起動 Recall)またはSPI命令(Software Recall)によって実行
    • Automatic STORE on power-down with a small capacitor (except for CY14B512Q1)
  • 高い信頼性
    • 回数に制限のないリード、ライト、RECALL サイクル
    • QuantumTrap に対する 100 万回の STORE サイクル
    • データ保存期間: 20 年
  • High speed serial peripheral interface (SPI)
    • 40 MHz clock rate
    • Supports SPI mode 0 (0,0) and mode 3 (1,1)
  • Write protection
    • Hardware protection using Write Protect (WP) pin
    • Software protection using Write Disable instruction
    • Software block protection for 1/4,1/2, or entire array
  • 低消費電力
    • Single 3 V +20%, –10% operation
    • Average active current of 10 mA at 40 MHz operation
  • Industry standard configurations
    • 工業用温度
    • CY14B512Q1 has identical pin configuration to industry standard 8-pin NV memory
    • 8-pin dual flat no-lead (DFN) package and 16-pin small outline integrated circuit (SOIC) package
    • Restriction of hazardous substances (RoHS) compliant

機能概要

The Cypress CY14B512Q1/CY14B512Q2/CY14B512Q3 combines a 512-Kbit nvSRAM with a nonvolatile element in each memory cell with serial SPI interface. メモリは各 8 ビットの単語 64K として構成されています。組み込み不揮発性エレメントには、QuantumTrap テクノロジが組み込まれており、世界でも最高レベルの信頼性を誇る不揮発性メモリを作り上げます。回数に制限のない読み取りと書き込みをSRAMで可能にする一方、高い信頼性を提供する不揮発性データ記憶域をQuantumTrapセルで実現しています。Data transfers from SRAM to the nonvolatile elements (STORE operation) takes place automatically at power-down (except for CY14B512Q1). On power-up, data is restored to the SRAM from the nonvolatile memory (RECALL operation). The STORE and RECALL operations can also be initiated by the user through SPI instruction.